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  Réalisation de phases de test en verilog sur FPGA Cyclone V, ARRIA X et MAX V avec Quartus Prime. Le but est de vérifier la fonctionnalité des fonctions externes autour du FPGA (I2C, Ethernet, PCIe, etc.) Une interface graphique en script TCL sera créer pour chaque phase de test, avec l'option System Console.



CEA - Commissariat à l'énergie atomique et aux énergies alternatives

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  Programmation d’une méthode de cryptage et de décryptage en CBC sur un STM32 Réalisation de deux interfaces graphiques pour démonstrateur DPA basé sur Raspberry 3 Programmation d’une méthode de cryptage et de décryptage en CBC sur un STM32 Réalisation de deux interfaces graphiques pour démonstrateur DPA basé sur Raspberry 3



SFR Business

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RAZEL-BEC

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  Rénovations de la Rue de Rome pour la nouvelle ligne du tramway Rénovations de la Rue de Rome pour la nouvelle ligne du tramway